PLL103-11中文資料PLL數(shù)據(jù)手冊(cè)PDF規(guī)格書
| 廠商型號(hào) |
PLL103-11 |
| 功能描述 | Low Skew Buffers |
| 文件大小 |
147.69 Kbytes |
| 頁(yè)面數(shù)量 |
7 頁(yè) |
| 生產(chǎn)廠商 | PhaseLink Corporation |
| 企業(yè)簡(jiǎn)稱 |
PLL |
| 中文名稱 | PhaseLink Corporation官網(wǎng) |
| 原廠標(biāo)識(shí) |  |
| 數(shù)據(jù)手冊(cè) | |
| 更新時(shí)間 | 2025-2-21 10:16:00 |
| 人工找貨 | PLL103-11價(jià)格和庫(kù)存，歡迎聯(lián)系客服免費(fèi)人工找貨 |
PLL103-11規(guī)格書詳情
FEATURES
? Generates 13 copies of High-speed clock inputs.
? Supports up to three SDRAM DIMMS synchronous clocks.
? Supports 2-wire I2C serial bus interface with readback.
? 50 duty cycle with low jitter.
? Less than 5ns delay.
? Skew between any outputs is less than 250 ps.
? Tri-state pin for testing.
? Frequency up to 150 MHz.
? 3.0V-3.7V Supply range.
? Available in 28-pin 300mil SOIC package.
產(chǎn)品屬性
- 型號(hào)：
PLL103-11
- 制造商：
PLL
- 制造商全稱：
PLL
- 功能描述：
Low Skew Buffers
| 供應(yīng)商 | 型號(hào) | 品牌 | 批號(hào) | 封裝 | 庫(kù)存 | 備注 | 價(jià)格 |
|---|---|---|---|---|---|---|---|
PHASELINK |
589220 |
16余年資質(zhì) 絕對(duì)原盒原盤 更多數(shù)量 |
詢價(jià) | ||||
PHASELINK |
22+ |
SOP8 |
5000 |
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Phaselink |
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SOP8 |
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原廠原裝正品 |
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PHASELINK |
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PhaseLink |
16+ |
SOP-8 |
8000 |
原裝現(xiàn)貨請(qǐng)來(lái)電咨詢 |
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PHASELINK |
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