ZL30415集成電路（IC）的應(yīng)用特定時(shí)鐘/定時(shí)規(guī)格書PDF中文資料
| 廠商型號(hào) |
ZL30415 |
| 參數(shù)屬性 | ZL30415 封裝/外殼為64-LFBGA；包裝為卷帶（TR）；類別為集成電路（IC）的應(yīng)用特定時(shí)鐘/定時(shí)；產(chǎn)品描述：IC PLL SONET/SDH CLK MULT 64CBGA |
| 功能描述 | SONET/SDH Clock Multiplier PLL |
| 封裝外殼 | 64-LFBGA |
| 文件大小 |
347.02 Kbytes |
| 頁(yè)面數(shù)量 |
23 頁(yè) |
| 生產(chǎn)廠商 | Zarlink Semiconductor |
| 企業(yè)簡(jiǎn)稱 |
ZARLINK |
| 中文名稱 | Zarlink Semiconductor官網(wǎng) |
| 原廠標(biāo)識(shí) |  |
| 數(shù)據(jù)手冊(cè) | |
| 更新時(shí)間 | 2025-2-25 20:00:00 |
| 人工找貨 | ZL30415價(jià)格和庫(kù)存，歡迎聯(lián)系客服免費(fèi)人工找貨 |
ZL30415規(guī)格書詳情
Description
The ZL30415 is an analog phase-locked loop (APLL) designed to provide jitter attenuation and rate conversion for SDH (Synchronous Digital Hierarchy) and SONET (Synchronous Optical Network) networking equipment. The ZL30415 generates low jitter output clocks that meet the jitter requirements of Telcordia GR-253-CORE OC-12, OC-3, OC-1 rates and ITU-T G.813 STM-4 and STM-1 rates.
Features
? Meets jitter requirements of Telcordia GR-253- CORE for OC-12, OC-3, and OC-1 rates
? Meets jitter requirements of ITU-T G.813 for STM- 4, and STM-1 rates
? Provides one differential LVPECL output clock selectable to 19.44 MHz, 38.88 MHz, 77.76 MHz, 155.52 MHz, or 622.08 MHz
? Provides a single-ended CMOS output clock at 19.44 MHz
? Accepts a single-ended CMOS reference at 19.44 MHz or a differential LVDS, LVPECL, or CML reference at 19.44 MHz or 77.76 MHz
? Provides a LOCK indication
? 3.3 V supply
Applications
? SONET/SDH line cards
產(chǎn)品屬性
- 產(chǎn)品編號(hào)：
ZL30415GGF
- 制造商：
Microsemi Corporation
- 類別：
集成電路（IC） > 應(yīng)用特定時(shí)鐘/定時(shí)
- 包裝：
卷帶（TR）
- PLL：
是
- 主要用途：
SONET/SDH
- 輸入：
CML，CMOS，LVDS，LVPECL
- 輸出：
CMOS，LVPECL
- 比率 - 輸入：
3：2
- 差分 - 輸入：
是/是
- 頻率 - 最大值：
622.08MHz
- 電壓 - 供電：
3V ~ 3.6V
- 工作溫度：
-40°C ~ 85°C
- 安裝類型：
表面貼裝型
- 封裝/外殼：
64-LFBGA
- 供應(yīng)商器件封裝：
64-CSPBGA（8x8）
- 描述：
IC PLL SONET/SDH CLK MULT 64CBGA
| 供應(yīng)商 | 型號(hào) | 品牌 | 批號(hào) | 封裝 | 庫(kù)存 | 備注 | 價(jià)格 |
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