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ADA4062-2ACPZ-R2中文資料亞德諾數(shù)據(jù)手冊PDF規(guī)格書

ADA4062-2ACPZ-R2
廠商型號

ADA4062-2ACPZ-R2

功能描述

Low Power JFET-Input Op Amps

絲印標(biāo)識

J

封裝外殼

LFCSP_UQ

文件大小

502.16 Kbytes

頁面數(shù)量

20

生產(chǎn)廠商 Analog Devices
企業(yè)簡稱

AD亞德諾

中文名稱

亞德諾半導(dǎo)體技術(shù)有限公司官網(wǎng)

原廠標(biāo)識
數(shù)據(jù)手冊

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更新時間

2025-7-9 18:42:00

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ADA4062-2ACPZ-R2規(guī)格書詳情

FEATURES

Low input bias current: 50 pA maximum

Offset voltage

1.5 mV maximum for B grade (ADA4062-2 SOIC package)

2.5 mV maximum for A grade

Offset voltage drift: 5 μV/°C typical

Slew rate: 3.3 V/μs typical

CMRR: 90 dB typical

Low supply current: 165 μA typical

High input impedance

Unity-gain stable

±5 V to ±15 V dual-supply operation

Packaging

8-lead SOIC, 8-lead MSOP, 10-lead LFCSP, 14-lead TSSOP, and 16-lead LFCSP packages

APPLICATIONS

Power controls and monitoring

Active filters

Industrial/process controls

Body probe electronics

Data acquisition

Integrators

Input buffering

供應(yīng)商 型號 品牌 批號 封裝 庫存 備注 價格
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