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8745BMI-21集成電路（IC）的時鐘發(fā)生器PLL頻率合成器規(guī)格書PDF中文資料
| 廠商型號 |
8745BMI-21 |
| 參數(shù)屬性 | 8745BMI-21 封裝/外殼為20-SOIC（0.295"，7.50mm 寬）；包裝為卷帶（TR）；類別為集成電路（IC）的時鐘發(fā)生器PLL頻率合成器；產(chǎn)品描述：IC CLK GEN 1:1 DIFF-LVDS 20-SOIC |
| 功能描述 | 1:1 Differential-to-LVDS Zero Delay Clock Generator |
| 絲印標識 | |
| 封裝外殼 | SOIC / 20-SOIC（0.295"，7.50mm 寬） |
| 文件大小 |
620.39 Kbytes |
| 頁面數(shù)量 |
21 頁 |
| 生產(chǎn)廠商 | Renesas Technology Corp |
| 企業(yè)簡稱 |
RENESAS【瑞薩】 |
| 中文名稱 | 瑞薩科技有限公司官網(wǎng) |
| 原廠標識 |  |
| 數(shù)據(jù)手冊 | |
| 更新時間 | 2025-4-28 17:56:00 |
| 人工找貨 | 8745BMI-21價格和庫存，歡迎聯(lián)系客服免費人工找貨 |
8745BMI-21規(guī)格書詳情
Features
? One differential LVDS output designed to meet
or exceed the requirements of ANSI TIA/EIA-644
One differential feedback output pair
? Differential CLK, nCLK input pair
? CLKx, nCLKx pair can accept the following differential
input levels: LVPECL, LVDS, LVHSTL, HCSL, SSTL
? Output frequency range: 31.25MHz to 700MHz
? Input frequency range: 31.25MHz to 700MHz
? VCO range: 250MHz to 700MHz
? External feedback for “zero delay” clock regeneration
with configurable frequencies
? Programmable dividers allow for the following output-to-input
frequency ratios: 8:1, 4:1, 2:1, 1:1, 1:2, 1:4, 1:8
? Cycle-to-cycle jitter: 30ps (maximum)
? Output skew: 40ps (maximum)
? Static phase offset: 25ps ± 125ps
? Full 3.3V supply voltage
? -40°C to 85°C ambient operating temperature
? Available in lead-free (RoHS 6) package
? For functional replacement part use 8T49N285
產(chǎn)品屬性
- 產(chǎn)品編號：
8745BMI-21LFT
- 制造商：
Renesas Electronics America Inc
- 類別：
集成電路（IC） > 時鐘發(fā)生器，PLL，頻率合成器
- 包裝：
卷帶（TR）
- 類型：
時鐘發(fā)生器
- PLL：
帶旁路
- 輸入：
HCSL，LVDS，LVHSTL，LVPECL，SSTL
- 輸出：
LVDS
- 比率 - 輸入：
1：1
- 差分 - 輸入：
是/是
- 頻率 - 最大值：
700MHz
- 分頻器/倍頻器：
是/是
- 電壓 - 供電：
3.135V ~ 3.465V
- 工作溫度：
-40°C ~ 85°C
- 安裝類型：
表面貼裝型
- 封裝/外殼：
20-SOIC（0.295"，7.50mm 寬）
- 供應(yīng)商器件封裝：
20-SOIC
- 描述：
IC CLK GEN 1
| 供應(yīng)商 | 型號 | 品牌 | 批號 | 封裝 | 庫存 | 備注 | 價格 |
|---|---|---|---|---|---|---|---|
INTEGRATEDCIRCUITSYSTEMS |
23+ |
NA |
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