74F112集成電路（IC）的觸發(fā)器規(guī)格書(shū)PDF中文資料
| 廠商型號(hào) |
74F112 |
| 參數(shù)屬性 | 74F112 封裝/外殼為16-SOIC（0.154"，3.90mm 寬）；包裝為管件；類別為集成電路（IC）的觸發(fā)器；產(chǎn)品描述：IC FF JK TYPE DUAL 1BIT 16SOIC |
| 功能描述 | Dual J-K negative edge-triggered flip-flop |
| 封裝外殼 | 16-SOIC（0.154"，3.90mm 寬） |
| 文件大小 |
83.94 Kbytes |
| 頁(yè)面數(shù)量 |
10 頁(yè) |
| 生產(chǎn)廠商 | NXP Semiconductors |
| 企業(yè)簡(jiǎn)稱 |
Philips【飛利浦】 |
| 中文名稱 | 荷蘭皇家飛利浦官網(wǎng) |
| 原廠標(biāo)識(shí) |  |
| 數(shù)據(jù)手冊(cè) | |
| 更新時(shí)間 | 2025-4-16 20:00:00 |
| 人工找貨 | 74F112價(jià)格和庫(kù)存，歡迎聯(lián)系客服免費(fèi)人工找貨 |
74F112規(guī)格書(shū)詳情
DESCRIPTION
The 74F112, Dual Negative Edge-Triggered JK-Type Flip-Flop, feature individual J, K, Clock (CPn), Set (SD) and Reset (RD) inputs, true (Qn) and complementary (Qn) outputs.
The SD and RD inputs, when Low, set or reset the outputs as shown in the Function Table, regardless of the level at the other inputs.
A High level on the clock (CPn) input enables the J and K inputs and data will be accepted. The logic levels at the J and K inputs may be allowed to change while the CPn is High and flip-flop will perform according to the Function Table as long as minimum setup and hold times are observed. Output changes are initiated by the High-to-Low transition of the CPn.
FEATURE
? Industrial temperature range available (–40°C to +85°C)
產(chǎn)品屬性
- 產(chǎn)品編號(hào)：
74F112SC
- 制造商：
onsemi
- 類別：
集成電路（IC） > 觸發(fā)器
- 系列：
74F
- 包裝：
管件
- 功能：
設(shè)置（預(yù)設(shè)）和復(fù)位
- 類型：
JK 型
- 輸出類型：
補(bǔ)充型
- 不同 V、最大 CL 時(shí)最大傳播延遲：
6.5ns @ 5V，50pF
- 觸發(fā)器類型：
負(fù)邊沿
- 電流 - 輸出高、低：
1mA，20mA
- 電壓 - 供電：
4.5V ~ 5.5V
- 工作溫度：
0°C ~ 70°C（TA）
- 安裝類型：
表面貼裝型
- 供應(yīng)商器件封裝：
16-SOIC
- 封裝/外殼：
16-SOIC（0.154"，3.90mm 寬）
- 描述：
IC FF JK TYPE DUAL 1BIT 16SOIC
| 供應(yīng)商 | 型號(hào) | 品牌 | 批號(hào) | 封裝 | 庫(kù)存 | 備注 | 價(jià)格 |
|---|---|---|---|---|---|---|---|
FUJITSU/富士通 |
24+ |
NA/ |
506 |
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FAIRCHILD |
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SOP16 |
2255 |
全新原裝進(jìn)口自己庫(kù)存優(yōu)勢(shì) |
詢價(jià) |
